ADS52J65
- 16 位分辨率,空闲 SNR:80dBFS
- 在 125MSPS 且每个信道包含 4 个通道时的功耗为 70mW/通道
- 在 62.5MSPS 且每个信道包含 8 个通道时的功耗为 45mW/通道
- 满量程输入:2VPP
- 满量程 SNR:78dBFS (fin = 10MHz)
- 满量程 SFDR:–85dBc (fin = 10MHz)
- 模拟输入 –3dB 带宽 = 250MHz
- 输入为 2VPP 时的最大输入信号频率 = 130MHz
- 快速且一致的过载恢复
- 高级数字 特性
- 直流失调电压自动校正
- 数字均流
- 数字 I/Q 解调器
- 分数抽取滤波器 M = 1 至 63(单位增量为 0.25)
- 数据输出速率在抽取后降低
- 在 80MSPS 且抽取因子 = 2 时的功耗为 64mW/通道
- 带有 32 个预设模式的片上 RAM
- JESD204B 子类 0、1 和 2
- 每个 JESD 信道包含 2、4 或 8 个通道
- 10Gbps JESD 接口
- 在线迹长度较短(小于 5 英寸)时支持高达 12.8Gbps 的信道速率
- 64 引脚非磁性 9mm × 9mm 封装
ADS52J65 8 通道 16 位模数转换器 (ADC) 采用 CMOS 工艺和创新型电路技术。该器件的工作功耗很低,使用 2Vpp 满量程输入,并提供极高的信噪比 (SNR) 性能。该器件在 5MHz 时提供 80dBFS 的空闲 SNR 和 78dBFS 的满量程 SNR。250MHz 的高输入带宽使得该器件适合于广泛的 应用,例如高频医疗超声、磁共振成像和多通道数据采集。该 ADC 集成了一个经过修整来匹配不同器件的内部基准。
ADS52J65 具有先进的数字 特性,包括带有分数抽取滤波器的数字 I/Q 解调器。该器件使用 8B 转 10B 格式对来自各个通道的 ADC 数据进行编码,使用电流模式逻辑 (CML) 输出缓冲器将这些数据作为串行器/解串器数据流发送,并遵循 JESD204B 标准。来自所有八个通道的 ADC 数据可通过单个 CML 缓冲器(单信道串行器/解串器)输出,数据速率限制为最高 12.8Gbps。使用串行器/解串器输出可减少接口线的数量。这样,与低功耗设计一起,可将八个通道封装在一个 9mm × 9mm 的 VQFN 封装内,从而实现高密度系统集成。ADS52J65 还支持通过四个 CML 缓冲器(四信道串行器/解串器)发送所有 ADC 数据的模式,因此可使低成本 FPGA 的每通道串行器/解串器数据速率降低。
ADS52J65 采用非磁性 VQFN 封装,此类封装不会产生任何磁性干扰。该器件的额定温度范围为 –40°C 至 +85°C。
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技术文档
类型 | 项目标题 | 下载最新的英语版本 | 日期 | |||
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* | 数据表 | 具有 JESD204B 接口的 ADS52J65 8 通道 16 位 125MSPS 70mW/通道 ADC 数据表 | PDF | HTML | 下载最新的英文版本 (Rev.A) | PDF | HTML | 2018年 12月 12日 |
应用手册 | 用于流式细胞术应用的高速模数转换器和放大器 | 下载英文版本 | 2021年 8月 18日 | |||
应用手册 | 所选封装材料的热学和电学性质 | 2008年 10月 16日 | ||||
应用手册 | 模数规格和性能特性术语表 (Rev. A) | 下载最新的英文版本 (Rev.B) | 2008年 10月 16日 | |||
应用手册 | 高速数据转换 | 下载英文版本 | 2008年 10月 16日 |
设计和开发
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ADS52J65EVM — 具有 JESD204B 接口的 ADS52J65 8 通道 16 位 125MSPS ADC 评估模块
ADS52J65 评估模块 (EVM) 是一款用于评估 ADS52J65 器件及其功能的平台。ADS52J65 可实现低功耗运行,并使用 2-Vpp 满量程输入提供非常高的信噪比 (SNR) 性能。此器件具有先进的数字功能,内置带有分数抽取滤波器的数字 I/Q 解调器。此器件使用 8B/10B 格式对来自各个通道的模数转换器 (ADC) 数据进行编码,并按照 JESD204B 标准,使用电流模式逻辑 (CML) 输出缓冲器将这些数据作为串行器/解串器 (SerDes) 数据流发送。
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VQFN (RGC) | 64 | 了解详情 |
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