ZHCSR52B October   2022  – November 2023 TMS320F2800132 , TMS320F2800133 , TMS320F2800135 , TMS320F2800137

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
    1. 3.1 功能方框图
  5. 4 器件比较
    1. 4.1 相关产品
  6. 5 引脚配置和功能
    1. 5.1 引脚图
    2. 5.2 引脚属性
    3. 5.3 信号说明
      1. 5.3.1 模拟信号
      2. 5.3.2 数字信号
      3. 5.3.3 电源和接地
      4. 5.3.4 测试、JTAG 和复位
    4. 5.4 引脚复用
      1. 5.4.1 GPIO 多路复用引脚
        1. 5.4.1.1 GPIO 多路复用引脚
      2. 5.4.2 ADC 引脚上的数字输入 (AIO)
      3. 5.4.3 ADC 引脚上的数字输入和输出 (AGPIO)
      4. 5.4.4 GPIO 输入 X-BAR
      5. 5.4.5 GPIO 输出 X-BAR 和 ePWM X-BAR
    5. 5.5 GPIO 和 ADC 分配
    6. 5.6 带有内部上拉和下拉的引脚
    7. 5.7 未使用引脚的连接
  7. 6 规格
    1. 6.1  绝对最大额定值
    2. 6.2  ESD 等级
    3. 6.3  建议运行条件
    4. 6.4  功耗摘要
      1. 6.4.1 系统电流消耗 - 启用 VREG - 内部电源
      2. 6.4.2 系统电流消耗 - 禁用 VREG - 外部电源
      3. 6.4.3 工作模式测试说明
      4. 6.4.4 电流消耗图
      5. 6.4.5 减少电流消耗
        1. 6.4.5.1 每个禁用外设的典型电流降低
    5. 6.5  电气特性
    6. 6.6  PM 封装的热阻特性
    7. 6.7  PT 封装的热阻特性
    8. 6.8  RGZ 封装的热阻特性
    9. 6.9  RHB 封装的热阻特性
    10. 6.10 散热设计注意事项
    11. 6.11 系统
      1. 6.11.1  电源管理模块 (PMM)
        1. 6.11.1.1 引言
        2. 6.11.1.2 概述
          1. 6.11.1.2.1 电源轨监视器
            1. 6.11.1.2.1.1 I/O POR（上电复位）监视器
            2. 6.11.1.2.1.2 I/O BOR（欠压复位）监视器
            3. 6.11.1.2.1.3 VDD POR（上电复位）监视器
          2. 6.11.1.2.2 外部监控器使用情况
          3. 6.11.1.2.3 延迟块
          4. 6.11.1.2.4 内部 1.2V LDO 稳压器 (VREG)
          5. 6.11.1.2.5 VREGENZ
        3. 6.11.1.3 外部元件
          1. 6.11.1.3.1 去耦电容器
            1. 6.11.1.3.1.1 VDDIO 去耦
            2. 6.11.1.3.1.2 VDD 去耦
        4. 6.11.1.4 电源时序
          1. 6.11.1.4.1 电源引脚联动
          2. 6.11.1.4.2 信号引脚电源序列
          3. 6.11.1.4.3 电源引脚电源序列
            1. 6.11.1.4.3.1 外部 VREG/VDD 模式序列
            2. 6.11.1.4.3.2 内部 VREG/VDD 模式序列
            3. 6.11.1.4.3.3 电源时序摘要和违规影响
            4. 6.11.1.4.3.4 电源压摆率
        5. 6.11.1.5 建议运行条件对 PMM 的适用性
        6. 6.11.1.6 电源管理模块电气数据和时序
          1. 6.11.1.6.1 电源管理模块运行条件
          2. 6.11.1.6.2 电源管理模块特征
          3.        电源电压
      2. 6.11.2  复位时序
        1. 6.11.2.1 复位源
        2. 6.11.2.2 复位电气数据和时序
          1. 6.11.2.2.1 复位 - XRSn - 时序要求
          2. 6.11.2.2.2 复位 - XRSn - 开关特性
          3. 6.11.2.2.3 复位时序图
      3. 6.11.3  时钟规范
        1. 6.11.3.1 时钟源
        2. 6.11.3.2 时钟频率、要求和特性
          1. 6.11.3.2.1 输入时钟频率和时序要求，PLL 锁定时间
            1. 6.11.3.2.1.1 输入时钟频率
            2. 6.11.3.2.1.2 XTAL 振荡器特征
            3. 6.11.3.2.1.3 使用外部时钟源（非晶体）时的 X1 输入电平特性
            4. 6.11.3.2.1.4 X1 时序要求
            5. 6.11.3.2.1.5 AUXCLKIN 时序要求
            6. 6.11.3.2.1.6 APLL 特性
            7. 6.11.3.2.1.7 XCLKOUT 开关特性 - 旁路或启用 PLL
            8. 6.11.3.2.1.8 内部时钟频率
        3. 6.11.3.3 输入时钟和 PLL
        4. 6.11.3.4 XTAL 振荡器
          1. 6.11.3.4.1 引言
          2. 6.11.3.4.2 概述
            1. 6.11.3.4.2.1 电子振荡器
              1. 6.11.3.4.2.1.1 运行模式
                1. 6.11.3.4.2.1.1.1 晶体的工作模式
                2. 6.11.3.4.2.1.1.2 单端工作模式
              2. 6.11.3.4.2.1.2 XCLKOUT 上的 XTAL 输出
            2. 6.11.3.4.2.2 石英晶体
            3. 6.11.3.4.2.3 GPIO 工作模式
          3. 6.11.3.4.3 正常运行
            1. 6.11.3.4.3.1 ESR – 有效串联电阻
            2. 6.11.3.4.3.2 Rneg - 负电阻
            3. 6.11.3.4.3.3 启动时间
              1. 6.11.3.4.3.3.1 X1/X2 前提条件
            4. 6.11.3.4.3.4 DL – 驱动电平
          4. 6.11.3.4.4 如何选择晶体
          5. 6.11.3.4.5 测试
          6. 6.11.3.4.6 常见问题和调试提示
          7. 6.11.3.4.7 晶体振荡器规格
            1. 6.11.3.4.7.1 晶体振荡器参数
            2. 6.11.3.4.7.2 晶振等效串联电阻 (ESR) 要求
            3. 6.11.3.4.7.3 晶体振荡器电气特性
        5. 6.11.3.5 内部振荡器
          1. 6.11.3.5.1 INTOSC 特性
          2. 6.11.3.5.2 INTOSC2 与外部精密电阻 (ExtR) 搭配使用
      4. 6.11.4  闪存参数
        1. 6.11.4.1 闪存参数 
      5. 6.11.5  RAM 规格
      6. 6.11.6  ROM 规格
      7. 6.11.7  仿真/JTAG
        1. 6.11.7.1 JTAG 电气数据和时序
          1. 6.11.7.1.1 JTAG 时序要求
          2. 6.11.7.1.2 JTAG 开关特征
          3. 6.11.7.1.3 JTAG 时序图
        2. 6.11.7.2 cJTAG 电气数据和时序
          1. 6.11.7.2.1 cJTAG 时序要求
          2. 6.11.7.2.2 cJTAG 开关特性
          3. 6.11.7.2.3 cJTAG 时序图
      8. 6.11.8  GPIO 电气数据和时序
        1. 6.11.8.1 GPIO - 输出时序
          1. 6.11.8.1.1 通用输出开关特征
          2. 6.11.8.1.2 通用输出时序图
        2. 6.11.8.2 GPIO - 输入时序
          1. 6.11.8.2.1 通用输入时序要求
          2. 6.11.8.2.2 采样模式
        3. 6.11.8.3 输入信号的采样窗口宽度
      9. 6.11.9  中断
        1. 6.11.9.1 外部中断 (XINT) 电气数据和时序
          1. 6.11.9.1.1 外部中断时序要求
          2. 6.11.9.1.2 外部中断开关特性
          3. 6.11.9.1.3 外部中断时序
      10. 6.11.10 低功率模式
        1. 6.11.10.1 时钟门控低功耗模式
        2. 6.11.10.2 低功耗模式唤醒时序
          1. 6.11.10.2.1 空闲模式时序要求
          2. 6.11.10.2.2 空闲模式开关特性
          3. 6.11.10.2.3 空闲进入和退出时序图
          4. 6.11.10.2.4 待机模式时序要求
          5. 6.11.10.2.5 待机模式开关特征
          6. 6.11.10.2.6 待机模式进入和退出时序图
          7. 6.11.10.2.7 停机模式时序要求
          8. 6.11.10.2.8 停机模式开关特征
          9. 6.11.10.2.9 停机模式进入和退出时序图
    12. 6.12 模拟外设
      1. 6.12.1 模拟引脚和内部连接
      2. 6.12.2 模拟信号说明
      3. 6.12.3 模数转换器 (ADC)
        1. 6.12.3.1 ADC 可配置性
          1. 6.12.3.1.1 信号模式
        2. 6.12.3.2 ADC 电气数据和时序
          1. 6.12.3.2.1 ADC 运行条件
          2. 6.12.3.2.2 ADC 特性
          3. 6.12.3.2.3 每个引脚的 ADC 性能
          4. 6.12.3.2.4 ADC 输入模型
          5. 6.12.3.2.5 ADC 时序图
      4. 6.12.4 温度传感器
        1. 6.12.4.1 温度传感器电气数据和时序
          1. 6.12.4.1.1 温度传感器特征
      5. 6.12.5 比较器子系统 (CMPSS)
        1. 6.12.5.1 CMPSS 模块型号
        2. 6.12.5.2 CMPx_DACL
        3. 6.12.5.3 CMPSS 连接图
        4. 6.12.5.4 方框图
        5. 6.12.5.5 CMPSS 电气数据和时序
          1. 6.12.5.5.1 CMPSS 比较器电气特性
          2. 6.12.5.5.2 CMPSS_LITE 比较器电气特性
          3.        CMPSS 比较器以输入为基准的偏移量和迟滞
          4. 6.12.5.5.3 CMPSS DAC 静态电气特性
          5. 6.12.5.5.4 CMPSS_LITE DAC 静态电气特性
          6. 6.12.5.5.5 CMPSS 示意图
          7. 6.12.5.5.6 CMPSS DAC 动态误差
          8. 6.12.5.5.7 CMPx_DACL 缓冲输出的运行条件
          9. 6.12.5.5.8 CMPx_DACL 缓冲输出的电气特性
    13. 6.13 控制外设
      1. 6.13.1 增强型脉宽调制器 (ePWM)
        1. 6.13.1.1 控制外设同步
        2. 6.13.1.2 ePWM 电气数据和时序
          1. 6.13.1.2.1 ePWM 时序要求
          2. 6.13.1.2.2 ePWM 开关特性
          3. 6.13.1.2.3 跳闸区输入时序
            1. 6.13.1.2.3.1 跳闸区域输入时序要求
            2. 6.13.1.2.3.2 PWM 高阻态特征时序图
      2. 6.13.2 高分辨率脉宽调制器 (HRPWM)
        1. 6.13.2.1 HRPWM 电气数据和时序
          1. 6.13.2.1.1 高分辨率 PWM 特征
      3. 6.13.3 外部 ADC 转换启动电气数据和时序
        1. 6.13.3.1 外部 ADC 转换启动开关特性
        2. 6.13.3.2 ADCSOCAO 或ADCSOCBO 时序图
      4. 6.13.4 增强型捕获 (eCAP)
        1. 6.13.4.1 eCAP 方框图
        2. 6.13.4.2 eCAP 同步
        3. 6.13.4.3 eCAP 电气数据和时序
          1. 6.13.4.3.1 eCAP 时序要求
          2. 6.13.4.3.2 eCAP 开关特性
      5. 6.13.5 增强型正交编码器脉冲 (eQEP)
        1. 6.13.5.1 eQEP 电气数据和时序
          1. 6.13.5.1.1 eQEP 时序要求
          2. 6.13.5.1.2 eQEP 开关特性
    14. 6.14 通信外设
      1. 6.14.1 控制器局域网 (CAN)
      2. 6.14.2 内部集成电路 (I2C)
        1. 6.14.2.1 I2C 电气数据和时序
          1. 6.14.2.1.1 I2C 时序要求
          2. 6.14.2.1.2 I2C 开关特征
          3. 6.14.2.1.3 I2C 时序图
      3. 6.14.3 串行通信接口 (SCI)
      4. 6.14.4 串行外设接口 (SPI)
        1. 6.14.4.1 SPI 主器件模式时序
          1. 6.14.4.1.1 SPI 主模式时序要求
          2. 6.14.4.1.2 SPI 主模式开关特性 - 时钟相位 0
          3. 6.14.4.1.3 SPI 主模式开关特性 - 时钟相位 1
          4. 6.14.4.1.4 SPI 主器件模式时序图
        2. 6.14.4.2 SPI 从器件模式时序
          1. 6.14.4.2.1 SPI 从模式时序要求
          2. 6.14.4.2.2 SPI 从模式开关特性
          3. 6.14.4.2.3 SPI 从器件模式时序图
  8. 7 详细说明
    1. 7.1  概述
    2. 7.2  功能方框图
    3. 7.3  存储器
      1. 7.3.1 内存映射
        1. 7.3.1.1 专用 RAM (Mx RAM)
        2. 7.3.1.2 本地共享 RAM (LSx RAM)
      2. 7.3.2 闪存映射
      3. 7.3.3 外设寄存器内存映射
    4. 7.4  标识
    5. 7.5  C28x 处理器
      1. 7.5.1 浮点单元 (FPU)
      2. 7.5.2 三角法数学单元 (TMU)
    6. 7.6  器件引导模式
      1. 7.6.1 器件引导配置
        1. 7.6.1.1 配置引导模式引脚
        2. 7.6.1.2 配置引导模式表选项
      2. 7.6.2 GPIO 分配
    7. 7.7  安全性
      1. 7.7.1 保护芯片边界
        1. 7.7.1.1 JTAGLOCK
        2. 7.7.1.2 零引脚引导
      2. 7.7.2 双区域安全
      3. 7.7.3 免责声明
    8. 7.8  看门狗
    9. 7.9  C28x 计时器
    10. 7.10 双路时钟比较器 (DCC)
      1. 7.10.1 特性
      2. 7.10.2 DCCx 时钟源中断的映射
  9. 8 应用、实施和布局
    1. 8.1 应用和实现
    2. 8.2 器件主要特性
    3. 8.3 应用信息
      1. 8.3.1 典型应用
        1. 8.3.1.1 空调室外机
          1. 8.3.1.1.1 系统方框图
          2. 8.3.1.1.2 空调室外机资源
        2. 8.3.1.2 洗衣机和烘干机
          1. 8.3.1.2.1 系统方框图
          2. 8.3.1.2.2 洗衣机和烘干机资源
        3. 8.3.1.3 割草机器人
          1. 8.3.1.3.1 系统方框图
          2. 8.3.1.3.2 割草机器人资源
        4. 8.3.1.4 商用电信整流器
          1. 8.3.1.4.1 系统方框图
          2. 8.3.1.4.2 商用通信电源整流器资源
  10. 9 器件和文档支持
    1. 9.1 入门和后续步骤
    2. 9.2 器件命名规则
    3. 9.3 标识
    4. 9.4 工具与软件
    5. 9.5 文档支持
    6. 9.6 支持资源
    7. 9.7 商标
    8. 9.8 静电放电警告
    9. 9.9 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

6.12.5 比较器子系统 (CMPSS)

比较器子系统 (CMPSS) 由模拟比较器和支持电路组成，这些电路对于峰值电流模式控制、开关模式电源、功率因数校正、电压跳闸监控等电源应用非常有用。

该器件包含两种型号的 CMPSS 模块：CMPSS 和 CMPSS_LITE。这些模块共用一个通用架构，但是某些特性只有完整 CMPSS 型号支持，而 CMPSS_LITE 型号并不支持。

比较器子系统基于多个模块构建而成。每个子系统包含两个比较器、两个基准 12 位 DAC（CMPSS_LITE 实例是 9.5 位有效基准 DAC）和两个数字滤波器。该子系统还包括一个斜坡发生器（仅限完整的 CMPSS 模块；CMPSS_LITE 实例并不支持）。比较器在每个模块中用“H”或“L”表示，其中“H”代表高电平，“L”代表低电平。每个比较器都会生成一个数字输出，指示正输入端的电压是否大于负输入端的电压。比较器的正输入由一个外部引脚驱动（请参阅 TMS320F280013x 实时微控制器技术参考手册 中的模拟子系统 一章，了解适用于 CMPSS 的多路复用器选项）。负输入可由外部引脚或可编程基准 12 位 DAC 驱动。每个比较器输出都会通过一个可编程的数字滤波器，该滤波器可以去除伪跳变信号。如果不需要滤波，也可以使用未滤波的输出。一个斜坡发生器电路可用于控制该子系统中高电平比较器的基准 12 位 DAC 值（仅限完整 CMPSS 模块；CMPSS_LITE 实例并不支持）。

每个 CMPSS 包含：

  • 两个模拟比较器
  • 两个可编程的基准 12 位 DAC（CMPSS_LITE 实例上为 9.5 位有效 DAC）
  • 一个斜坡发生器（仅限完整 CMPSS；CMPSS_LITE 实例上没有）
  • 两个数字滤波器，65536 最大滤波器时钟预分频
  • 能够将各个子模块与 EPWMSYNCPER 同步
  • 能够通过 EPWMBLANK 扩展清除信号
  • 能够将输出与 SYSCLK 同步
  • 能够锁存输出
  • 能够反转输出
  • 可选择在输入端使用迟滞
  • 可选择通过外部信号或基准 DAC 驱动比较器的负输入
  • 可选择在外部引脚上使用低电平比较器 DAC 输出 CMPx_DACL（仅限部分实例，不能与比较功能同时使用）