ZHCSYA5 May   2025 ADS117L14 , ADS117L18

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 时序要求
    7. 5.7 开关特性
    8. 5.8 时序图
    9. 5.9 典型特性
  7. 6 参数测量信息
    1. 6.1  失调电压误差测量
    2. 6.2  温漂测量
    3. 6.3  增益误差测量
    4. 6.4  增益漂移测量
    5. 6.5  NMRR 测量
    6. 6.6  CMRR 测量
    7. 6.7  PSRR 测量
    8. 6.8  SNR 测量
    9. 6.9  INL 误差测量
    10. 6.10 THD 测量
    11. 6.11 IMD 测量
    12. 6.12 SFDR 测量
    13. 6.13 噪声性能
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 模拟输入（AINP、AINN）
        1. 7.3.1.1 输入范围
      2. 7.3.2 基准电压（REFP、REFN）
        1. 7.3.2.1 基准电压范围
      3. 7.3.3 时钟运行
        1. 7.3.3.1 时钟分频器
        2. 7.3.3.2 内部振荡器
        3. 7.3.3.3 外部时钟
      4. 7.3.4 上电复位 (POR)
      5. 7.3.5 VCM 输出电压
      6. 7.3.6 GPIO
      7. 7.3.7 调制器
      8. 7.3.8 数字滤波器
        1. 7.3.8.1 宽带滤波器
        2. 7.3.8.2 低延迟滤波器 (Sinc)
          1. 7.3.8.2.1 Sinc4 滤波器
          2. 7.3.8.2.2 Sinc4 + Sinc1 级联滤波器
          3. 7.3.8.2.3 Sinc3 滤波器
          4. 7.3.8.2.4 Sinc3 + Sinc1 滤波器
    4. 7.4 器件功能模式
      1. 7.4.1 复位
        1. 7.4.1.1 RESET 引脚
        2. 7.4.1.2 通过 SPI 寄存器进行复位
        3. 7.4.1.3 通过 SPI 输入模式进行复位
      2. 7.4.2 空闲和待机模式
      3. 7.4.3 断电
      4. 7.4.4 速度模式
      5. 7.4.5 同步
        1. 7.4.5.1 同步控制模式
        2. 7.4.5.2 启动/停止控制模式
      6. 7.4.6 转换开始延迟时间
      7. 7.4.7 校准
        1. 7.4.7.1 偏移校准寄存器
        2. 7.4.7.2 增益校准寄存器
        3. 7.4.7.3 校准过程
      8. 7.4.8 诊断
        1. 7.4.8.1 ERROR 引脚和 ERR_FLAG 位
        2. 7.4.8.2 SPI CRC
        3. 7.4.8.3 寄存器映射 CRC
        4. 7.4.8.4 ADC 误差
        5. 7.4.8.5 SPI 地址范围
        6. 7.4.8.6 SCLK 计数器
        7. 7.4.8.7 时钟计数器
        8. 7.4.8.8 帧同步 CRC
        9. 7.4.8.9 自检
      9. 7.4.9 帧同步数据端口
        1. 7.4.9.1  数据包
        2. 7.4.9.2  数据格式
        3. 7.4.9.3  STATUS_DP 标头字节
        4. 7.4.9.4  FSYNC 引脚
        5. 7.4.9.5  DCLK 引脚
        6. 7.4.9.6  DOUTx 引脚
        7. 7.4.9.7  DINx 引脚
        8. 7.4.9.8  时分多路复用
        9. 7.4.9.9  菊花链
        10. 7.4.9.10 DOUTx 时序
    5. 7.5 编程
      1. 7.5.1 硬件编程
      2. 7.5.2 SPI 编程
        1. 7.5.2.1 片选 (CS)
        2. 7.5.2.2 串行时钟 (SCLK)
        3. 7.5.2.3 串行数据输入 (SDI)
        4. 7.5.2.4 串行数据输出 (SDO)
      3. 7.5.3 SPI 帧
      4. 7.5.4 命令
        1. 7.5.4.1 写入寄存器命令
        2. 7.5.4.2 读取寄存器命令
      5. 7.5.5 SPI 菊花链
  9. 8 寄存器映射
  10. 9 应用和实施
    1. 9.1 应用信息
      1. 9.1.1 输入驱动器
      2. 9.1.2 抗混叠滤波器
      3. 9.1.3 基准电压
    2. 9.2 典型应用
      1. 9.2.1 设计要求
      2. 9.2.2 详细设计过程
      3. 9.2.3 应用曲线
    3. 9.3 电源相关建议
      1. 9.3.1 AVDD1 和 AVSS
      2. 9.3.2 AVDD2
      3. 9.3.3 IOVDD
      4. 9.3.4 CAPA 和 CAPD
    4. 9.4 布局
      1. 9.4.1 布局指南
      2. 9.4.2 布局示例
  11. 10器件和文档支持
    1. 10.1 文档支持
      1. 10.1.1 相关文档
    2. 10.2 接收文档更新通知
    3. 10.3 支持资源
    4. 10.4 商标
    5. 10.5 静电放电警告
    6. 10.6 术语表
  12. 11修订历史记录
  13. 12机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

7.3.8.1 宽带滤波器

宽带滤波器作为多级 FIR 设计，具有线性相位响应、平坦通带振幅、窄过渡带和高阻带衰减特性。由于这些特性，推荐使用此滤波器测量交流信号。ADC 提供八个可编程 OSR 值和四种速度模式，从而提供不同的数据速率、带宽和分辨率选项。

图 7-12 至图 7-16 说明了宽带滤波器的频率响应。图 7-12 展示了通带纹波的详细信息。图 7-13 展示了过渡带的频率响应。

ADS117L14 ADS117L18 宽带滤波器通带纹波
 
图 7-12 宽带滤波器通带纹波
ADS117L14 ADS117L18 宽带滤波器过渡带
 
图 7-13 宽带滤波器过渡带

图 7-14 显示了 OSR ≥ 64 时 fDATA 的频率响应。阻带从 fDATA/2 开始，可以防止奈奎斯特频率下的混叠。图 7-15 显示了 OSR = 32 时 fMOD 的阻带衰减。在阻带区中，带外输入频率与 fMOD / 32 斩波频率的倍数进行混合。此过程会创建一系列阻带响应峰值，这些峰值超过数字滤波器所提供的衰减。响应峰值的宽度是滤波器带宽的两倍。当与 ADC 输入上的抗混叠滤波器配合使用时，可提高阻带衰减。

ADS117L14 ADS117L18 宽带滤波器频率响应
OSR ≥ 64
图 7-14 宽带滤波器频率响应
ADS117L14 ADS117L18 宽带滤波器阻带
OSR = 32
图 7-15 宽带滤波器阻带

图 7-16 显示了以 fMOD 为中心的滤波器响应，其中重复出现滤波器响应。如果不被抗混叠滤波器去除，fMOD 下的输入频率在通带中显示为混叠频率。输入频率为 fMOD 的倍数时，也会出现混叠。这些频段的定义如下：

方程式 16. Alias frequency bands: (N · fMOD) ± fBW

其中：

  • N = 1、2、3 等
  • fMOD = 调制器采样频率
  • fBW = 滤波器带宽

ADS117L14 ADS117L18 以 fMOD 为中心的宽带滤波器频率响应
 
图 7-16 以 fMOD 为中心的宽带滤波器频率响应

滤波器的群延迟是信号从滤波器的输入端传播到输出端的时间。由于滤波器是线性相位设计，因此多频复杂信号的包络不会因滤波器处理而失真。群延迟（以时间单位表示）相对于信号频率保持恒定，等于 34/fDATA。请注意，在向 ADC 输入施加阶跃输入后，68 个数据周期之后会出现完全稳定的数据。图 7-17 展示了滤波器群延迟 (34/fDATA) 和阶跃输入的稳定时间 (68/fDATA)。

ADS117L14 ADS117L18 宽带滤波器阶跃响应
 
图 7-17 宽带滤波器阶跃响应

当 ADC 同步时，数字滤波器会重新启动。同步后，滤波器会丢弃接下来的 68 次转换以考虑滤波器稳定时间。表 7-7 的延迟时间 列中列出了同步后在帧同步端口上出现第一次转换的时间。延迟时间包括滤波器复位的初始开销时间。第一个数据是完全稳定的数据。如果在连续转换时出现阶跃输入，则接下来的 69 次转换不是完全稳定的数据。

表 7-2 宽带滤波器特性
模式fCLK
(MHz)		OSR数据速率
(kSPS)		–0.1dB 频率
(kHz)		–3dB 频率
(kHz)		延迟时间(1)
(µs)
最大速度32.76832512211.2223.9134.2
高速25.6400165174.96171.8
中速12.820082.587.48343.5
低速3.25020.6321.871374
最大速度32.76864256105.6112.0267.0
高速25.620082.587.48341.8
中速12.810041.2543.74683.5
低速3.22510.3110.942734
最大速度32.76812812852.855.99532.0
高速25.610041.2543.74681.0
中速12.85020.6321.871362
低速3.212.55.15625.4685448
最大速度32.7682566426.428.001064
高速25.65020.62521.871362
中速12.82510.3110.932724
低速3.26.252.5782.73410895
最大速度32.7685123213.214.002126
高速25.62510.31210.9352721
中速12.812.55.1565.4675443
低速3.23.1251.2891.36721770
最大速度32.7681024166.67.9984251
高速25.612.55.1565.4675441
中速12.86.252.5782.73410883
低速3.21.56250.6450.683443530
最大速度32.768204883.33.4998501
高速25.66.252.5782.73410881
中速12.83.1251.2891.36721762
低速3.20.781250.3220.341787050
最大速度32.768409641.651.75017001
高速25.63.1251.2891.36721761
中速12.81.56250.6450.683443522
低速3.20.3906250.1610.1709174090
(1) 当启用模拟输入缓冲器后，延迟时间增加 8/fCLK (µs)。