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DS90CR218A

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+3.3V 上升沿数据选通 LVDS 21 位频道链接接收器 - 85MHz

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Protocols Catalog Rating Catalog Operating temperature range (°C) -10 to 70
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TSSOP (DGG) 48 101.25 mm² 12.5 x 8.1
  • 12 to 85 MHz Shift Clock Support
  • 50% Duty Cycle on Receiver Output Clock
  • Low Power Consumption
  • ±1V Common-mode Range (Around +1.2V)
  • Narrow Bus Reduces Cable Size and Cost
  • Up to 1.785 Gbps Throughput
  • Up to 223 Mbytes/sec Bandwidth
  • 345 mV (typ) Swing LVDS Devices for Low EMI
  • PLL Requires No External Components
  • Rising Edge Data Strobe
  • Compatible with TIA/EIA-644 LVDS Standard
  • Low Profile 48-Lead TSSOP Package

All trademarks are the property of their respective owners.

  • 12 to 85 MHz Shift Clock Support
  • 50% Duty Cycle on Receiver Output Clock
  • Low Power Consumption
  • ±1V Common-mode Range (Around +1.2V)
  • Narrow Bus Reduces Cable Size and Cost
  • Up to 1.785 Gbps Throughput
  • Up to 223 Mbytes/sec Bandwidth
  • 345 mV (typ) Swing LVDS Devices for Low EMI
  • PLL Requires No External Components
  • Rising Edge Data Strobe
  • Compatible with TIA/EIA-644 LVDS Standard
  • Low Profile 48-Lead TSSOP Package

All trademarks are the property of their respective owners.

The DS90CR218A receiver deserializes three input LVDS data streams into 21 bits of CMOS/TTL output data. When operating at the maximum input clock rate of 85 Mhz, the LVDS data is received at 595 Mbps per data channel for a total data throughput of 1.785 Gbit/sec (233 Mbytes/sec).

The narrow bus and LVDS signalling of the DS90CR218A is an ideal means to solve EMI and cable size problems associated with wide, high-speed TTL interfaces.

The DS90CR218A receiver deserializes three input LVDS data streams into 21 bits of CMOS/TTL output data. When operating at the maximum input clock rate of 85 Mhz, the LVDS data is received at 595 Mbps per data channel for a total data throughput of 1.785 Gbit/sec (233 Mbytes/sec).

The narrow bus and LVDS signalling of the DS90CR218A is an ideal means to solve EMI and cable size problems associated with wide, high-speed TTL interfaces.
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类型 标题 下载最新的英语版本 日期
* 数据表 DS90CR218A 3.3VRising Edge Data Strobe LVDS 21Bit Chan Link 12MHz to 85MHz 数据表 (Rev. D) 2013年 4月 22日
应用手册 High-Speed Layout Guidelines for Reducing EMI for LVDS SerDes Designs 2018年 11月 9日
应用手册 Receiver Skew Margin for Channel Link I and FPD Link I Devices 2016年 1月 13日
应用手册 AN-1538 Interfacing Nationals DS90CR218A and LM98714 (Rev. C) 2013年 4月 26日
设计指南 Channel Link I Design Guide 2007年 3月 29日
应用手册 Application Note 1538 Interfacing Nationals DS90CR218A and LM98714 (cn) 2007年 3月 17日
应用手册 Multi-Drop Channel-Link Operation 2004年 10月 4日
应用手册 CHANNEL LINK Moving and Shaping Information In Point-To-Point Applications 1998年 10月 5日

设计和开发

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仿真模型

DS90CR218A IBIS Model

SNLM058.ZIP (5 KB) - IBIS Model
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如需获取可用 TINA-TI 模型的完整列表，请参阅：SpiceRack - 完整列表 

需要 HSpice (...)

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  • MTBF/时基故障估算
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